S710D-EST2 数据收发器 控制模块工控备件库存

S710D-EST2每一路高速收发器包括发送器和接收器两个通道,发送器和接收器都是由物理编码子层(PCS,p场si-cal coding sublayer)与物理介质附加子层(PMA, physi-cal media additional sublayer)两部分组成。
S710D-EST2包括兼容所支持协议的收发器中的数字功能的硬核逻辑实现，发送通道包括相位补偿FIFO、字节串行器、8B/10B编码器等模块;接收通道包括字对齐器、速率匹配CFIFO,8B/10B解码器、 字节解串器、字节排序器、相位补偿FIFO等模块。
S710D-EST2包括I/O缓冲器的模拟电路、CDR、 串行器/解串器(SER/DES以及用于优化串行数据通道性能的可编程预加重与均衡。设备收发器通道工作时，FPGA架构中的输出并行数据通过发送器PCS和PMA进行传输，终转化为串行数据发送出去。S710D-EST2接收到的输人串行数据通过接收器PMA和PCS的处理以串行数据格式传输到FP以架构内部中，进行下一步的处理。
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